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[TI] C64x+ 定点 DSP - TMS320C6424ZWT6 NFBGA (ZWT) 数字信号处理器

[TI] C64x+ 定点 DSP - TMS320C6424ZWT6 NFBGA (ZWT) 数字信号处理器

来源:本站时间:2024-10-14浏览数:

TMS320C6424ZWT6器件是一款C64x+ 定点 DSP - 高达 600MHz、16/8 位 EMIFA、32/16 位 DDR2、SDRAM。

TMS320C6424ZWT6器件是一款C64x+ 定点 DSP - 高达 600MHz、16/8 位 EMIFA、32/16 位 DDR2、SDRAM。


说明:

TMS320C6424ZWT6器件基于TI的第三代高性能高级VelociTI超长指令字(VLIW)架构,是TMS320C6000™ DSP平台中性能最高的定点DSP产品。


C64x+内核在600 MHz时钟速率下的性能高达每秒48亿条指令(MIPS),为高性能DSP编程挑战提供了解决方案。该DSP内核具有高速控制器的操作灵活性和阵列处理器的数字能力。

实物图.jpg

参数:

核心:C64x+

类型:定点

接口:EBI/EMI,HPI,I2C,McASP,McBSP,UART,10/100 以太网 MAC

时钟速率:600MHz

非易失性存储器:ROM(64kB)

片载 RAM:240kB

电压 - I/O:1.8V,3.3V

电压 - 内核:1.05V,1.20V

工作温度:0°C ~ 90°C(TJ)

安装类型:表面贴装型

封装/外壳:361-LFBGA

供应商器件封装:361-NFBGA(16x16)


应用:

电信

音频

工业应用


特性:

高性能数字信号处理器(C6424)

2.5纳秒、2纳秒、1.67纳秒和1.43纳秒指令周期时间

400、500、600 MHz C64x+时钟速率

八条32位C64x+指令/周期

3200,4000,4800,5600 MIPS

与C64x完全软件兼容

商业和汽车(Q或S后缀)等级

低功率设备(L后缀)

VelociTI.2扩展VelociTI高级超长指令字(VLIW)TMS 320 c 64 x+DSP内核

带有VelociTI.2扩展的八个高度独立的功能单元:

六个alu(32/40位),每个时钟周期支持单32位、双16位或四8位算术运算

两个乘法器支持每个时钟周期四次16 × 16位乘法(32位结果)或八次8 × 8位乘法(16位结果)

具有不一致支持的加载存储架构

64个32位通用寄存器

指令打包减少了代码量

所有指令都有条件

其他C64x+增强功能

保护模式操作

错误检测和程序重定向的异常支持

对模循环自动聚焦模块操作的硬件支持

C64x+指令集功能

字节可寻址(8/16/32/64位数据)

8位溢出保护

位域提取、设置、清除

标准化、饱和、位计数

VelociTI.2增加正交性

C64x+扩展

精简16位指令

支持复数乘法的附加指令

C64x+ L1/L2内存架构

256K位(32K字节)L1P程序RAM/高速缓存[灵活分配]

640千位(80千字节)L1D数据RAM/高速缓存[灵活分配]

1M位(128K字节)L2统一映射RAM/高速缓存[灵活分配]

端序:支持小端序和大端序

外部存储器接口(EMIFs)

32位DDR2 SDRAM存储器控制器,具有256M字节地址空间(1.8V I/O)

支持高达333 MHz(数据速率)的总线和与DDR2-400 SDRAM的接口

异步16位宽EMIF (EMIFA ),地址范围高达128M字节

闪存接口

NOR(8/16位宽数据)

NAND(8/16位宽数据)

增强型直接内存访问(EDMA)控制器(64个独立通道)

两个64位通用定时器(每个可配置为两个32位定时器)

一个64位看门狗定时器

两个UARTs(一个带RTs和CTS流量控制)

主/从内部集成电路(I2C总线)

两个多通道缓冲串行端口(McBSPs)

I2S和TDM

AC97音频编解码器接口

精力

标准语音编解码器接口(AIC12)

电信接口- ST总线,H-100

128通道模式

多通道音频串行端口(McASP0)

四个串行器和SPDIF (DIT)模式

16位主机端口接口(HPI)

32位33 MHz 3.3V外设部件互连(PCI)主/从接口

10/100 Mb/s以太网MAC (EMAC)

符合IEEE 802.3标准

支持多种媒体独立接口(MII、RMII)

管理数据输入/输出(MDIO)模块

VLYNQ接口(FPGA接口)

三路脉宽调制器(PWM)输出

片内ROM引导加载程序

单独的省电模式

灵活的PLL时钟发生器

兼容IEEE-1149.1 (JTAG)边界扫描

多达111个通用I/O (GPIO)引脚(与其它器件功能复用)

包装:

361引脚无铅PBGA封装(ZWT后缀),0.8毫米球距

376引脚塑料BGA封装(ZDU后缀),1.0mm球距

0.09微米/6层铜金属工艺(CMOS)

3.3V和1.8V输入/输出,1.2V内部(-7/-6/-5/-4/-Q6/-Q5/-Q4)

3.3V和1.8V输入/输出,1.05V内部(-7/-6/-5/-4/-L/-Q5)


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